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[主观题]

已知一Moore型时序逻辑电路的状态图如图P6-5所示,试列出该时序逻辑电路的状态表。设初始状态为0

00,触发器为上升沿起作用,画出其工作波形图(不少于8个时钟脉冲)。

已知一Moore型时序逻辑电路的状态图如图P6-5所示,试列出该时序逻辑电路的状态表。设初始状态为0

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第1题
Moore型时序逻辑电路的输出与外输入和内部状态都有关。()
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第2题
UML中可以用来为需求建模的图形是:()。

A.用例图

B.状态图

C.时序图

D.活动图

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第3题
试用下降沿出发的D触发器设计一同步时序电路,状态图如6.3.4(a),S0,S1,S2的编码如6
试用下降沿出发的D触发器设计一同步时序电路,状态图如6.3.4(a),S0,S1,S2的编码如6

.3.4(a)。

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第4题
图3.45(a)表示某个时序机的状态图,对应的状态表如表3.22(a)所示.该时序机的特点是输入变量(控

图3.45(a)表示某个时序机的状态图,对应的状态表如表3.22(a)所示.该时序机的特点是输入变量(控制变量)比较多,逻辑复杂.当输入(控制)变量多于3个时,状态图(或状态表)十分复杂.请采用文字表示转换条件的方法,将图3.45(a)改造成等价的MDS图和状态表.

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第5题
简述时序逻辑电路与组合逻辑电路的区别。

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第6题
设计一个同步时序逻辑电路,实现如图P5.25所示的输出.

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第7题
电路和时钟波形如图5.32所示.1)写出DSR、Z的函数表达式,作出Q0、Q1、Q2的完全状态图

电路和时钟波形如图5.32所示.

1)写出DSR、Z的函数表达式,作出Q0、Q1、Q2的完全状态图.

2)分别画出Q0、Q1、Q2及Z的时序图.

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第8题
时序逻辑电路的输出信号不仅取决于当时的输入信号,而且还取决于电路().
时序逻辑电路的输出信号不仅取决于当时的输入信号,而且还取决于电路().

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第9题
异步时序逻辑电路中各个触发器所用的时钟触发沿不完全相同。()
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第10题
同步时序逻辑电路按其()的关系不同,分为()和()两类.

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第11题
分析图P6.2给出的同步时序逻辑电路,写出电路的驱动方程、状态方程和输出方程,画出电路的状态转换图,说明电路能否自启动。
分析图P6.2给出的同步时序逻辑电路,写出电路的驱动方程、状态方程和输出方程,画出电路的状态转换图,说明电路能否自启动。

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