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[主观题]

设计一个同步时序逻辑电路,实现如图P5.25所示的输出.

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第1题

在异步时序逻辑电路中，由于各触发器共用一个时钟脉冲，因此各触发器的动作时间同步。（)

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第2题

在同步时序逻辑电路中，由于各触发器不共用一个时钟脉冲，因此各触发器的动作时间不同步。（)

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第3题

同步时序逻辑电路中一定包含（)。

A.触发器

B.组合逻辑电路

C.移位寄存器

D.译码器

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第4题

已知一Moore型时序逻辑电路的状态图如图P6-5所示，试列出该时序逻辑电路的状态表。设初始状态为0

00,触发器为上升沿起作用，画出其工作波形图(不少于8个时钟脉冲)。

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第5题

脉冲异步时序逻辑电路与同步时序逻辑电路的主要区别是输入为脉冲信号。（)

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第6题

时序逻辑电路如图10.105所示.请写出电路的激励方程和输出方程,做出转移/输出表,画出状态转移图

.

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第7题

同步时序逻辑电路按其（)的关系不同,分为（)和（)两类.

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第8题

时序逻辑电路计数器计数模与规定值不符时，要检查清零端是同步还是异步清零。（)

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第9题

分析图P6.2给出的同步时序逻辑电路，写出电路的驱动方程、状态方程和输出方程，画出电路的状态转换图，说明电路能否自启动。

分析图P6.2给出的同步时序逻辑电路，写出电路的驱动方程、状态方程和输出方程，画出电路的状态转换图，说明电路能否自启动。

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